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de "strobe" para operar asincrónicamente. En cualquiera de los dos casos, estos solo pueden

trabajar en modo esclavo, es decir, necesitan de una lógica, interna o externa, que controle

el proceso de carga y envío de datos, desde y hacia el bus USB.

El chip FX2 posee una lógica interna que permite controlar estos FIFOs, la interfaz

general programable, GPIF (por sus siglas en inglés), que es una máquina de estados finita

programada por el usuario, permite implementar diversos protocolos de intercambio de

datos al configurar las entradas y salidas disponibles para este fin; tal máquina puede

funcionar ya sea con un reloj externo o con el reloj interno.

Por último se debe mencionar que el chip cuenta con varios puertos de entrada y

salida que permiten el envío y recepción de datos, así como funcionar a manera de puertos

de entrada/salida de uso general.

Este chip viene en presentaciones de 128, 100 y 56 pines, cada presentación varía en

la cantidad de puertos de entrada/salida disponibles, así como la presencia de varias señales

de control útiles, tales como los temporizadores. La figura 5.1.2 muestra las diversas

configuraciones de pines disponibles.

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